A3T2GF40CBF-HP

Zentel Japan
155-A3T2GF40CBF-HP
A3T2GF40CBF-HP

Fab. :

Description :
DRAM DDR3&DDR3L 2Gb, 128Mx16, 1866 at CL13, 1.35V&1.5V, FBGA-96

Fiche technique:
Modèle de ECAO:
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En stock: 6

Stock:
6 Expédition possible immédiatement
Délai usine :
16 Semaines Délai de production estimé en usine pour des quantités supérieures à celles indiquées.
Les quantités supérieures à 6 seront soumises à des commandes minimales.
Minimum : 1   Multiples : 1
Prix unitaire:
-,-- €
Ext. Prix:
-,-- €
Tarif est.:

Prix (EUR)

Qté. Prix unitaire
Ext. Prix
6,37 € 6,37 €
5,93 € 59,30 €
5,74 € 143,50 €
5,61 € 280,50 €
5,47 € 547,00 €
5,30 € 1.325,00 €
5,16 € 2.580,00 €
5,13 € 5.130,00 €
4,95 € 10.345,50 €

Attribut de produit Valeur d'attribut Sélectionner l'attribut
Zentel Japan
Catégorie du produit: DRAM
RoHS:  
SDRAM - DDR3L
2 Gbit
16 bit
933 MHz
FPGA-96
128 M x 16
1.283 V
1.575 V
0 C
+ 95 C
DDR3(L)
Tray
Marque: Zentel Japan
Sensibles à l’humidité: Yes
Style de montage: SMD/SMT
Type de produit: DRAM
Nombre de pièces de l'usine: 2090
Sous-catégorie: Memory & Data Storage
Courant d’alimentation maximal: 82 mA
Nom commercial: Zentel Japan
Poids de l''unité: 234,800 mg
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Attributs sélectionnés: 0

Fiche technique

CNHTS:
8542329000
USHTS:
8542320036
ECCN:
EAR99

DDR3 SDRAM

Zentel DDR3 SDRAM features a high-speed data transfer that is realized by the 8 bits prefetch pipelined architecture. The SDRAM has a double-data-rate architecture with two data transfers per clock cycle. They have a bi-directional differential data strobe (DQS and /DQS) and are transmitted/received with data for capturing data at the receiver. DQS is edge-aligned with data for READs; center-aligned with data for WRITEs. The differential clock inputs (CK and /CK) DLL aligns DQ and DQS transitions with CK transitions.

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