TMS320VC5509APGE

Texas Instruments
595-MS320VC5509APGE
TMS320VC5509APGE

Fab. :

Description :
Processeurs et contrôleurs à signaux numériques - DSP, DSC Fixed-Pt Dig Sig Pro c

Modèle de ECAO:
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En stock: 595

Stock:
595 Expédition possible immédiatement
Délai usine :
18 Semaines Délai de production estimé en usine pour des quantités supérieures à celles indiquées.
Minimum : 1   Multiples : 1
Prix unitaire:
-,-- €
Ext. Prix:
-,-- €
Tarif est.:

Prix (EUR)

Qté. Prix unitaire
Ext. Prix
29,31 € 29,31 €
23,79 € 237,90 €
21,38 € 534,50 €
20,73 € 2.487,60 €
20,04 € 4.809,60 €
19,95 € 9.576,00 €
1.200 Devis

Attribut de produit Valeur d'attribut Sélectionner l'attribut
Texas Instruments
Catégorie du produit: Processeurs et contrôleurs à signaux numériques - DSP, DSC
RoHS:  
DSPs
C55x
1 Core
200 MHz
LQFP-144
64 kB
256 kB
1.2 V
TMS320VC5509A
C5000
SMD/SMT
- 40 C
+ 85 C
Tray
Marque: Texas Instruments
Pays d’assemblage: Not Available
Pays de diffusion: Not Available
Pays d'origine: PH
Largeur du bus de données: 32 bit
Taille de la ROM de données: 64 kB
Kit de développement: TMDSDSK5509
Tension d'E/S: 3.3 V
Type d'instructions: Fixed Point
Sensibles à l’humidité: Yes
Nombre d'E/S: 8 I/O
Type de produit: DSP - Digital Signal Processors & Controllers
Type de la mémoire programme: Asynchronous SRAM, EPROM, Synchronous SDRAM, SBSRAM
Nombre de pièces de l'usine: 60
Sous-catégorie: Embedded Processors & Controllers
Raccourcis pour l'article N°: VC55GPSPGE
Poids de l''unité: 1,290 g
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Attributs sélectionnés: 0

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TARIC:
8542319000
CNHTS:
8542319092
CAHTS:
8542310000
USHTS:
8542310035
JPHTS:
8542310335
KRHTS:
8542311000
MXHTS:
8542310399
ECCN:
3A991.a.2

Processeur de signal numérique à point fixe TMS320VC5509

Les processeurs de signal numérique (DSP) à point fixe TMS320VC5509 de Texas Instruments sont basés sur le cœur de processeur CPU de génération DSP TMS320C55x. L'architecture DSP du TMS320C55x de Texas Instruments permet d'obtenir des performances élevées et une faible consommation d'énergie grâce à un parallélisme accru et à une réduction totale de la dissipation d'énergie. L'unité centrale prend en charge une structure de bus interne composée d'un bus de programme, de trois bus de lecture de données, de deux bus d'écriture de données et de bus supplémentaires dédiés aux périphériques et à l'activité DMA. Ces bus permettent d'effectuer jusqu'à trois lectures de données et deux écritures de données en un seul cycle. En parallèle, le contrôleur DMA peut effectuer jusqu'à deux transferts de données par cycle, indépendamment de l'activité du CPU.

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