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TMS320VC5503ZAY

Name: Texas Instruments TMS320VC5503ZAY
Brand: Texas Instruments
SKU: 595-TMS320VC5503ZAY
Price: 14.62 EUR
Availability: InStock

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N° Mouser :

595-TMS320VC5503ZAY

N° de fab. :

TMS320VC5503ZAY

Fab. :

Texas Instruments

Description :

Processeurs et contrôleurs à signaux numériques - DSP, DSC Low power C55x fixed point DSP- up to 20

Fiche technique:

TMS320VC5503ZAY Fiche technique

Modèle de ECAO:

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-,-- €

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-,-- €

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Prix (EUR)

Qté.	Prix unitaire	Ext. Prix
	14,62 €	14,62 €
	11,57 €	115,70 €
	10,80 €	270,00 €
	9,96 €	996,00 €
	9,56 €	2.390,00 €
	9,32 €	4.473,60 €
	9,12 €	10.214,40 €

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Attribut de produit	Valeur d'attribut	Sélectionner l'attribut
Fabricant:	Texas Instruments
Catégorie du produit:	Processeurs et contrôleurs à signaux numériques - DSP, DSC
RoHS:
Produit:	DSPs
Coeur:	C55x
Nombre de cœurs:	1 Core
Fréquence de l'horloge max.:	200 MHz
Package/Boîte:	NFBGA-179
Taille de la mémoire du programme:	64 kB
Taille de la RAM de données:	64 kB
Tension d'alimentation de fonctionnement:	1.6 V
Série:	TMS320VC5503
Style de montage:	SMD/SMT
Température de fonctionnement min.:	- 40 C
Température de fonctionnement max.:	+ 85 C
Conditionnement:	Tray
Marque:	Texas Instruments
Taille de la ROM de données:	32 kbit
Type d'instructions:	Fixed Point
Type d'interface:	I2C
Sensibles à l’humidité:	Yes
Type de produit:	DSP - Digital Signal Processors & Controllers
Nombre de pièces de l'usine:	160
Sous-catégorie:	Embedded Processors & Controllers
Tension d’alimentation - Max.:	1.65 V
Tension d’alimentation - Min.:	1.55 V
Horloges de surveillance (type watchdog):	Watchdog Timer

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Fiche technique

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Application Notes

PCN

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TARIC:: 8542319000
CAHTS:: 8542310000
USHTS:: 8542310035
ECCN:: 3A991.a.2

Processeur de signal numérique à point fixe TMS320VC5503

Le processeur de signal numérique (DSP) à point fixe TMS320VC5503 de Texas Instruments est basé sur le cœur de processeur UCT/CPU de génération DSP TMS320C55x. L'architecture DSP du TMS320C55x de Texas Instruments permet d'obtenir des performances élevées et une faible consommation d'énergie grâce à un parallélisme accru et à une réduction totale de la dissipation d'énergie. L'unité centrale prend en charge une structure de bus interne composée d'un bus de programme, de trois bus de lecture de données, de deux bus d'écriture de données et de bus supplémentaires dédiés aux périphériques et à l'activité DMA. Ces bus permettent d'effectuer jusqu'à trois lectures de données et deux écritures de données en un seul cycle. En parallèle, le contrôleur DMA peut effectuer jusqu'à deux transferts de données par cycle, indépendamment de l'activité du CPU.

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