TMS320VC5502PGF300

Texas Instruments
595-S320VC5502PGF300
TMS320VC5502PGF300

Fab. :

Description :
Processeurs et contrôleurs à signaux numériques - DSP, DSC Fixed-Pt Dig Signal Processor

Modèle de ECAO:
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En stock: 119

Stock:
119 Expédition possible immédiatement
Délai usine :
18 Semaines Délai de production estimé en usine pour des quantités supérieures à celles indiquées.
Minimum : 1   Multiples : 1
Prix unitaire:
-,-- €
Ext. Prix:
-,-- €
Tarif est.:

Prix (EUR)

Qté. Prix unitaire
Ext. Prix
16,39 € 16,39 €
13,06 € 130,60 €
11,89 € 297,25 €
11,21 € 1.345,20 €
10,83 € 3.032,40 €
10,60 € 5.088,00 €
10,54 € 11.804,80 €
2.560 Devis

Attribut de produit Valeur d'attribut Sélectionner l'attribut
Texas Instruments
Catégorie du produit: Processeurs et contrôleurs à signaux numériques - DSP, DSC
RoHS:  
DSPs
C55x
1 Core
300 MHz
LQFP-176
32 kB
64 kB
16 kB
1.26 V
TMS320VC5502
TMS320
SMD/SMT
- 40 C
+ 85 C
Tray
Marque: Texas Instruments
Pays d’assemblage: PH
Pays de diffusion: US
Pays d'origine: PH
Largeur du bus de données: 32 bit
Taille de la ROM de données: 32 kB
Type d'instructions: Fixed Point
Sensibles à l’humidité: Yes
Nombre d'E/S: 8 I/O
Type de produit: DSP - Digital Signal Processors & Controllers
Type de la mémoire programme: Asynchronous SRAM, EPROM, Synchronous SDRAM, SBSRAM
Nombre de pièces de l'usine: 40
Sous-catégorie: Embedded Processors & Controllers
Poids de l''unité: 1,896 g
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Attributs sélectionnés: 0

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TARIC:
8542319000
CNHTS:
8542319090
CAHTS:
8542310000
USHTS:
8542310035
JPHTS:
8542310335
KRHTS:
8542311000
MXHTS:
8542330299
ECCN:
3A991.a.2

Processeur de signal numérique à point fixe TMS320VC5502

Le processeur de signaux numériques (DSP) à points fixes TMS320VC5502 de Texas Instruments est basé sur le cœur de processeur CPU de génération DSP TMS320C55x. L’architecture DSP TMS320C55x de Texas Instruments atteint de hautes performances et une faible consommation grâce à un parallélisme accru et à une concentration totale sur la réduction de dissipation d'énergie. Le CPU adopte une structure interne de bus composée d’un bus de programme, de trois bus de lecture de données, de deux bus d’écriture de données et de bus supplémentaires dédiés à l’activité périphérique et de DMA. Ces bus peuvent effectuer jusqu’à trois lectures de données et deux écritures de données en un seul cycle. En parallèle, le contrôleur de DMA peut effectuer jusqu’à deux transferts de données par cycle, quelle que soit l’activité de CPU.

Processors

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