CDCU877RHAT

Texas Instruments
595-CDCU877RHAT
CDCU877RHAT

Fab. :

Description :
Commande et distribution d'horloge 1.8v PLL Clock Drive r A 595-CDCU877RHAR A 595-CDCU877RHAR

Modèle de ECAO:
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En stock: 281

Stock:
281 Expédition possible immédiatement
Délai usine :
6 Semaines Délai de production estimé en usine pour des quantités supérieures à celles indiquées.
Minimum : 1   Multiples : 1
Prix unitaire:
-,-- €
Ext. Prix:
-,-- €
Tarif est.:
Conditionnement:
Bobine complète(s) (commandez en multiples de 250)

Prix (EUR)

Qté. Prix unitaire
Ext. Prix
Ruban à découper / MouseReel™
10,11 € 10,11 €
7,93 € 79,30 €
7,39 € 184,75 €
6,79 € 679,00 €
Bobine complète(s) (commandez en multiples de 250)
6,50 € 1.625,00 €
6,24 € 3.120,00 €
6,15 € 6.150,00 €
5.000 Devis
† Les frais pour 5,00 € MouseReel™ seront calculés et ajoutés à votre panier. Les commandes MouseReel™ ne peuvent être ni annulées ni retournées.

Attribut de produit Valeur d'attribut Sélectionner l'attribut
Texas Instruments
Catégorie du produit: Commande et distribution d'horloge
RoHS:  
SSTL-18
400 MHz
SSTL-18
VQFN-40
1.7 V
1.9 V
CDCU877
- 40 C
+ 85 C
Reel
Cut Tape
MouseReel
Marque: Texas Instruments
Pays d’assemblage: Not Available
Pays de diffusion: Not Available
Pays d'origine: MY
Sensibles à l’humidité: Yes
Style de montage: SMD/SMT
Courant d'alimentation de fonctionnement: 135 mA
Produit: Clock Drivers
Type de produit: Clock Drivers & Distribution
Nombre de pièces de l'usine: 250
Sous-catégorie: Clock & Timer ICs
Type: Phase-Locked-Loops (PLLs) and Oscillators
Poids de l''unité: 104 mg
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Attributs sélectionnés: 0

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TARIC:
8542399000
CNHTS:
8542319090
CAHTS:
8542390000
USHTS:
8542390090
JPHTS:
8542390990
MXHTS:
85423999
ECCN:
EAR99

Pilote d'horloge de boucle à verrouillage de phase CDCU877

Le pilote d'horloge de boucle de verrouillage de phase CDCU877 de Texas Instruments est un tampon sans délai, à faible gigue et hautes performances. Il distribue une paire d'entrée d'horloge différentielle (CK, /CK) à 10 paires différentielles de sorties d'horloge (Yn, /Yn) et une paire différentielle de sorties d'horloge de rétroaction (FBOUT, /FBOUT). Les sorties d'horloge sont contrôlées par les horloges d'entrée (CK, /CK), les horloges de retour (FBIN, /FBIN), les broches de contrôle LVCMOS (OE, OS) et l'entrée d'alimentation analogique (AVDD). Lorsque OE est basse, les sorties d'horloge, à l'exception de FBOUT, /FBOUT, sont désactivées tandis que la PLL interne maintient sa fréquence verrouillée. OS (sélection de sortie) est une broche de programme qui doit être reliée à GND ou VDD. Lorsque OS est élevée, OE fonctionne comme décrit précédemment. Lorsque OS et OE sont toutes deux basses, OE n'affecte pas Y7, /Y7, car ces derniers fonctionnent librement. Lorsque AVDD est mis à la terre, la PLL est désactivée et contournée à des fins de test.