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CD74AC164BQAR

Name: Texas Instruments CD74AC164BQAR
Brand: Texas Instruments
SKU: 595-CD74AC164BQAR
Price: 0.59 EUR
Availability: InStock

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N° Mouser :

595-CD74AC164BQAR

N° de fab. :

CD74AC164BQAR

Fab. :

Texas Instruments

Description :

Registres à décalage compteur 8-Bit Serial-In/Para llel-Out Shift Regi

Cycle de vie:

Nouveau produit:

Nouveau chez ce fabricant.

Fiche technique:

CD74AC164BQAR Fiche technique

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-,-- €

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Prix (EUR)

Qté.	Prix unitaire	Ext. Prix
	0,593 €	0,59 €
	0,421 €	4,21 €
	0,378 €	9,45 €
	0,331 €	33,10 €
	0,308 €	77,00 €
	0,295 €	147,50 €
	0,29 €	290,00 €
Bobine complète(s) (commandez en multiples de 3000)
	0,268 €	804,00 €
	0,262 €	1.572,00 €

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Attribut de produit	Valeur d'attribut	Sélectionner l'attribut
Fabricant:	Texas Instruments
Catégorie du produit:	Registres à décalage compteur
RoHS:
Nombre de bits:	8 bit
Package/Boîte:	WQFN-14
Type de logique:	CMOS
Nombre de lignes d'entrée:	4 Input
Délai de propagation:	157 ns
Tension d’alimentation - Min.:	1.5 V
Tension d’alimentation - Max.:	5.5 V
Température de fonctionnement min.:	- 55 C
Température de fonctionnement max.:	+ 125 C
Conditionnement:	Reel
Conditionnement:	Cut Tape
Marque:	Texas Instruments
Pays d’assemblage:	Not Available
Pays de diffusion:	Not Available
Pays d'origine:	CN
Courant de sortie de haut niveau:	- 24 mA
Courant de sortie de bas niveau:	24 mA
Style de montage:	SMD/SMT
Nombre de lignes de sortie:	8 Output
Tension d'alimentation de fonctionnement:	1.5 V to 5.5 V
Produit:	Shift Registers
Type de produit:	Counter Shift Registers
Série:	CD74AC164
Nombre de pièces de l'usine:	3000
Sous-catégorie:	Logic ICs

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TARIC:: 8542319000
CNHTS:: 8542399000
USHTS:: 8542390090
MXHTS:: 8542399999
ECCN:: EAR99

Registres à décalage SIPO de 8 bits CD74AC164/CD74ACT164

Les registres à décalage SIPO de 8 bitsCD74AC164/CD74ACT164 de Texas Instruments possèdent deux entrées série (A et B) connectées via une grille AND et une entrée transparente asynchrone (CLR). Le dispositif nécessite un signal haut sur A et B pour mettre la ligne de données d’entrée sur un niveau élevé ; un signal bas sur l’une ou l’autre des deux lignes définira la ligne de données d’entrée sur un niveau bas. Les données A et B peuvent être modifiées lorsque CLK est haut ou bas, à condition que les exigences de temps de préparation minimum soient respectées.