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LS1023ABE9MQB

Name: NXP LS1023ABE9MQB
Brand: NXP Semiconductors
SKU: 771-LS1023ABE9MQB
Price: 69.91 EUR
Availability: OutOfStock

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N° Mouser :

771-LS1023ABE9MQB

N° de fab. :

LS1023ABE9MQB

Fab. :

NXP Semiconductors

Description :

Microprocesseurs - MPU Layerscape 64-bit Arm Cortex-A53, Dual-core, 1.2GHz, AEC-Q100 Grade 2, Security enabled, 23x23 pkg

Fiche technique:

LS1023ABE9MQB Fiche technique (PDF)

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Fabricant:	NXP
Catégorie du produit:	Microprocesseurs - MPU
Restrictions en matière d'expédition :	Il se peut que des documents supplémentaires soient nécessaires pour une exportation depuis les États-Unis.
RoHS:
Coeur:	ARM Cortex A53
Nombre de cœurs:	2 Core
Largeur du bus de données:	64 bit
Fréquence de l'horloge max.:	1.2 GHz
Package/Boîte:	FCPBGA-780
Mémoire cache de niveau 1 pour instructions:	32 kB
Mémoire cache de niveau 1 pour données:	32 kB
Tension d'alimentation de fonctionnement:	1 V
Série:	LS1023A
Style de montage:	SMD/SMT
Température de fonctionnement min.:	- 40 C
Température de fonctionnement max.:	+ 105 C
Qualification:	AEC-Q100
Conditionnement:	Tray
Marque:	NXP Semiconductors
Pays d’assemblage:	Not Available
Pays de diffusion:	Not Available
Pays d'origine:	KR
Taille de la RAM de données:	128 kB
Type d'interface:	Ethernet, I2C, PCI-e, Serial, USB
L2 Mémoire cache des données/instructions:	1 MB
Type de mémoire:	DDR3L / DDR4 SDRAM
Sensibles à l’humidité:	Yes
Nombre d'horloges/de compteurs:	8 Timer
Gamme de processeur:	QorIQ LS1023A_Auto
Type de produit:	Microprocessors - MPU
Nombre de pièces de l'usine:	60
Sous-catégorie:	Microprocessors - MPU
Nom commercial:	QorIQ
Horloges de surveillance (type watchdog):	Watchdog Timer
Raccourcis pour l'article N°:	935382427557

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Fiche technique

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TARIC:: 8542319000
CNHTS:: 8542319091
USHTS:: 8542310045
ECCN:: 5A002.a.1

Layerscape Architecture

NXP Layerscape Architecture is the underlying system architecture of the QorIQ® LS series processors. The architecture enables next-generation networks with up to 100Gb/s performance and enhanced packet processing capabilities. Design effort is simplified with a standard, open programming model and a software-aware architecture framework. This design enables customers to fully exploit the underlying hardware for maximum optimization, with the capability to easily adapt to network changes for real-time soft control over the network. A uniform hardware and software model provides the compatibility and scalability required for designing end-to-end networking equipment from home-to carrier-class products. The core-agnostic architecture incorporates the optimum core for the given application: Arm® cores or Power Architecture® cores.