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25CS320-I/SN

Name: Microchip 25CS320-I/SN
Brand: Microchip Technology
SKU: 579-25CS320-I/SN
Price: 0.4 EUR
Availability: InStock

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Voir les caractéristiques du produit

N° Mouser :

579-25CS320-I/SN

N° de fab. :

25CS320-I/SN

Fab. :

Microchip Technology

Description :

EEPROM 32 Kbit SPI SERIAL EEPROM w/ECC, 8-SOIC Bulk, 85C Industrial

Cycle de vie:

Nouveau produit:

Nouveau chez ce fabricant.

Fiche technique:

25CS320-I/SN Fiche technique (PDF)

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Attribut de produit	Valeur d'attribut	Sélectionner l'attribut
Fabricant:	Microchip
Catégorie du produit:	EEPROM
RoHS:
Taille de la mémoire:	32 kbit
Type d'interface:	SPI
Fréquence de l'horloge max.:	20 MHz
Organisation:	4 k x 8
Package/Boîte:	SOIC-8
Temps d'accès:	20 ns
Tension d’alimentation - Min.:	1.7 V
Tension d’alimentation - Max.:	5.5 V
Style de montage:	SMD/SMT
Rétention des données:	200 Year
Température de fonctionnement min.:	- 40 C
Température de fonctionnement max.:	+ 85 C
Conditionnement:	Tube
Courant de lecture actif maximal:	5 mA
Marque:	Microchip Technology
Pays d’assemblage:	Not Available
Pays de diffusion:	Not Available
Pays d'origine:	TH
Courant d'alimentation de fonctionnement:	10 uA
Type de produit:	EEPROM
Nombre de pièces de l'usine:	100
Sous-catégorie:	Memory & Data Storage

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Fiche technique

25CS320-I/SN Fiche technique (PDF)

PCN

Product Change Notification 2025-5-28 (PDF)

TARIC:: 8542327500
USHTS:: 8542320051
ECCN:: EAR99

EEPROM série SPI 25CS320 32-Kbit

EEPROM série SPI 25CS320 32-Kbit de Microchip Technology utilise un bus compatible SPI organisé en 4096 octets de 8 bits chacun (4 KB). Le 25CS320 de Microchip Technology est conçu pour les applications automobiles, grand public et industrielles et propose un stockage mémoire fiable et non volatile avec une large tension d'exploitation de 1,7 V à 5,5 V. Le dispositif nécessite une entrée d'horloge (SCK), d'entrée de données (SI) et de sortie de données (SO), avec un accès contrôlé via une entrée de sélection de puce (CS). Il dispose également d'une fonction de pause, permettant à l'hôte de gérer les tâches prioritaires tout en ignorant les transitions d'entrée, à l'exception de la sélection de puce.